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aircraft银虫 (小有名气)
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作为储能材料，介电损耗一般要多低才有用？
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对介电不太了解，但我捣鼓了一些聚合物复合材料出来，在1000hz时候，常温，介电常数上万甚至10w或者更高，但介电损耗也比较高，在个位数或者几十。 我知道损耗要尽量低，但是我不知道这个多低才有意义？或者说相对于一定的介电常数，相应的损耗应该低于多少？ 求专业人士解答，多谢！ 牛逼答案加金币哈！ |
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呵呵，我说不上行家，就是经常接触做这些材料的同学，对于测试过程比较熟悉。如果你设想你做的材料用于电容器，你可以查一查国家标准，像钛酸钡等介电材料一般也就百分之一左右，否则发热、漏导会很严重。 我看了图片，介电损耗挺高的，我对PVDF不是很了解，我建议你看看CCTO的相关报道，CCTO当年冒出来就是因为介电常数巨大，同时也因为介电损耗大而有争议。（CCTO是指CaCuTiO化合物，具体化学式我不记得了） 从测试的角度来讲，当介电损耗很大时，尤其是你的材料有导电物质，直流电导会对影响介电常数的测试，使介电常数虚高，你的测试结果也有所反映（10kHz以下），这是有理论模型可以分析的 |
17楼2013-01-08 16:25:09
fly_feiyu
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从如此巨大的损耗来看，1kHz下的介电常数很大一部分是由空间电荷等贡献的，你看看更高频率下的介电常数，如1MHz。像钛酸钡等陶瓷，常用于多层陶瓷电容器（MLCC），介电损耗也就百分之几。 现在研究有机材料和反铁电材料用作高功率储能的也很火，尤其是PVDF等，这种应用一般都在几百或上千Hz下测试电滞回线来计算储能密度 |
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7楼2013-01-06 23:40:16
aircraft
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看来你是行家。我传个图，选了根曲线，红色的是介电常数，黑色的是介电损耗。 跟你交个底吧，我是制备的PVDF与导电填料的复合材料，当然这其中还涉及到晶型的变化，填料的分布。 我知道在低频的时候，肯定是由于界面极化效应而导致的高介电常数，但在高频的时候，其介电常数依然很高。 （纯的PVDF一般都恒定在10以下）但是这个损耗，我就不知道相应要多低才有意义，所以求教大家了！ 还有，您说的电滞回线看储能密度，我这种类型的含导电相的复合材料，估计做不了吧？或者做出来结果也不可能好吧？因为我觉得他击穿强度肯定很低。 111111111111111.JPG(63.38KB) http://kuai.xunlei.com/d/LnU4DfrzVqLrUAQAd53?p=130497 |
10楼2013-01-08 12:42:50
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