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如何降低及稳定晶界层电容的介电常数
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| 请问一下有没有做晶界层电容的虫虫，在不影响损耗的前提下，如何降低其介电常数；为什么同样工艺做的陶瓷片，介电常数相差那么大呢，甚至叠在一起烧结，上下差别也很大，百思不得其解，请求高人指点。 |
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2楼2012-05-16 14:36:07
ballack315629
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3楼2012-05-17 17:22:22
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