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bymyself

金虫 (小有名气)

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Originally posted by nishi1000 at 2010-1-22 21:58:

阻抗试验怎么算浸泡时间?
关于这方面的文献目前没有看到过,这是一种加工工艺做出来的,但其他工艺做出来的和别人报道的相似,因为镁合金的耐腐蚀性能差,现在出现的这个图谱表示镁合金在没有涂层保护的情况下 ...

我就直接什么时候浸泡了,就开始计时。不过至少等浸泡了10分钟,让开路电位稳定的时候再开始测试。不过不知道你的情况怎么样。呵呵
21楼2010-01-24 20:36:27
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nishi1000

金虫 (小有名气)

引用回帖:
Originally posted by bymyself at 2010-1-24 20:36:

我就直接什么时候浸泡了,就开始计时。不过至少等浸泡了10分钟,让开路电位稳定的时候再开始测试。不过不知道你的情况怎么样。呵呵

哦,这个我在做的过程也有,测下开路电位等稳定后再测阻抗,参数里面不是有偏置电位设置么,需要这个参数
22楼2010-01-24 21:09:36
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IASCC

银虫 (正式写手)


nishi1000(金币+1):谢谢参与
这个阻抗谱已经很不错了
应该很好拟合
提醒一点:等效电路中 要加入感抗L
23楼2010-01-27 21:42:43
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IASCC

银虫 (正式写手)

nishi1000(金币+5): 2010-01-30 08:56
因为你的明显开始出现感抗弧
24楼2010-01-27 21:43:34
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nishi1000

金虫 (小有名气)

引用回帖:
Originally posted by IASCC at 2010-01-27 21:43:34:
因为你的明显开始出现感抗弧

请教怎么加,在软件里找不到这个电路,拟合不出该值
25楼2010-01-30 08:56:39
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IASCC

银虫 (正式写手)

nishi1000(金币+4): 2010-02-01 21:33
引用回帖:
Originally posted by nishi1000 at 2010-01-30 08:56:39:

请教怎么加,在软件里找不到这个电路,拟合不出该值

我仔细看了下你的EIS图谱,谱图上应该是有两个半圆,表明你的镁合金表面在你的测试体系应该有两个表面过程,也就是说可能存在两层不同结构的表面膜,你可以通过SEM/EDS验证。两个半圆后出现感抗,说明两层膜都被穿透,基体开始腐蚀(可能是点蚀开始了)。所以你的等效电路要体现三个时间常数。
我给你提出一个等效电路,你可以拟合试试:R0(C1R1)(C2R2)(LR3)
26楼2010-01-30 20:26:24
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nishi1000

金虫 (小有名气)

引用回帖:
Originally posted by IASCC at 2010-01-30 20:26:24:



我仔细看了下你的EIS图谱,谱图上应该是有两个半圆,表明你的镁合金表面在你的测试体系应该有两个表面过程,也就是说可能存在两层不同结构的表面膜,你可以通过SEM/EDS验证。两个半圆后出现感抗,说明两层膜 ...

我拟合了,找不到这个电路,而且我觉得这个图的感抗不明显,附件里是另外一个交流阻抗谱,它的感抗要比这个图明显些,不知道这个感抗怎么加进去,赐教,非常感谢!
27楼2010-02-04 09:35:01
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那个

金虫 (著名写手)


小木虫(金币+0.5):给个红包,谢谢回帖交流
27楼的阻抗和6楼的阻抗相差太大,27楼的还靠谱些
镁合金腐蚀是会出现感抗的,你看看 guangling song当年怎么忽悠的吧,镁合金阻抗谱的分析重点不在感抗,主流说法是和一价镁离子有关。
另外,但从曲线看你的仪器有问题,或者实验过程没有认真操作哦。
俺们中心提供各种分析测试,iso品质,有需要站内哈~~~~
28楼2010-02-04 10:00:06
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nishi1000

金虫 (小有名气)

引用回帖:
Originally posted by 那个 at 2010-02-04 10:00:06:
27楼的阻抗和6楼的阻抗相差太大,27楼的还靠谱些
镁合金腐蚀是会出现感抗的,你看看 guangling song当年怎么忽悠的吧,镁合金阻抗谱的分析重点不在感抗,主流说法是和一价镁离子有关。
另外,但从曲线看你的仪器 ...

27l楼的阻抗谱是另外的一种合金,与6楼的不一样,所以相差很大
29楼2010-02-04 12:46:43
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